博碩士論文 93533005 詳細資訊




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姓名 鍾政哲(Cheng-che Chung)  查詢紙本館藏   畢業系所 通訊工程學系在職專班
論文名稱 數位電視接收機時序與頻域同步之模擬與實現
(Simulation and Implementation of Frequency and Timing Synchronization for DVB-T Receivers)
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摘要(中) 近幾年來,數位電視地面廣播技術的發展與演進;在規格上可分為三大類。其中歐洲規格(DVB-T)所採用的調變方式正是被稱為正交分頻多工(OFDM)的調變技術。此技術在無線傳輸通道下能提供高速率傳輸、高效率頻譜使用率的多媒體服務以及對抗頻率選擇性的通道衰減的良好特性。然而美中不足的是,同步誤差對於OFDM系統效能影響甚劇。在這個部分,我們需要關注的包含了符碼時間及載波頻率。其作法主要依賴循環字首(Cyclic Prefix ; CP)重複的相關性以及使用已知的導引訊號(pilot signals)來進行。
本論文將就非同步對OFDM系統的影響進行研究分析,驗證估測方式,以建立一個適用於DVB-T接收機的同步系統。並以硬體描述語言Verilog撰寫RTL程式模組,搭配ModelSim軟體環境與先前Matlab所做估測作比較並交互驗證模組的時序及功能。
摘要(英) Recently, there are three major different specifications developed for the terrestrial digital video broadcasting. The terrestrial digital video broadcasting (DVB-T) of European Standard has adopted the orthogonal frequency division multiplexing (OFDM) modulation technique, which offers high-rates, high bandwidth-efficient digital transmission, and various multimedia services over frequency-selective fading channels. However, OFDM technique is very sensitive to synchronization errors, and this deeply impacts system performance. What we concern for synchronization errors includes symbol timing, carrier frequency offset (CFO). The synchronization scheme is mainly based on the correlation of cyclic prefix and the known pilot signals.
This thesis has studied the effect of synchronization errors on OFDM systems, and presented synchronization schemes for DVB-T receivers. We use hardware description language - Verilog and MolelSim to implement the synchronization schemes and verify the design by using Matlab simulation results for the RTL model.
關鍵字(中) ★ 同步
★ 頻域
★ 時序
★ 數位電視接收機
關鍵字(英) ★ DVB-T
★ Frequency and Timing Synchronization
論文目次 第一章 序論 - 1 -
1.1 研究動機與背景 - 1 -
1.2 OFDM技術的產生與應用 - 3 -
1.3 OFDM技術的優缺點 - 4 -
1.4 研究方法與目的 - 6 -
1.5 章節提要 - 6 -
第二章 系統模型 - 8 -
2.1 OFDM調變原理 - 8 -
2.2 OFDM系統模型 - 11 -
2.3 DVB-T系統規格簡介 - 14 -
2.4 階層調變(Hierarchical modulation) - 16 -
2.5 DVB-T系統Frame架構 - 19 -
2.6 DVB-T系統導引信號 - 20 -
第三章 同步系統介紹 - 23 -
3.1 同步問題介紹 - 23 -
3.2 符碼時序偏移之影響 - 24 -
3.2.1 解決符碼時序偏移 - 延遲相關器 - 28 -
3.3 載波頻率偏移之影響 - 29 -
3.3.1 小數倍載波頻率偏移之影響與估測方式 - 31 -
第四章 電腦Matlab模擬與Verilog實現 - 33 -
第五章 結論與未來發展 - 45 -
參考文獻 - 46 -
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[10] Ray Andraka,“A survey of CORDIC algorithms for FPGA based computers,”Artech House, 2000.
指導教授 陳永芳(Yuan-fang Chen) 審核日期 2007-7-16
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